NPU/FPGA 协同助手
规划 NPU 与 FPGA 的任务边界、接口协议和性能估算
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规划 NPU 与 FPGA 的任务边界、接口协议和性能估算
核对 AXI-Lite 寄存器映射、RTL 语义、驱动访问和文档描述之间的一致性
把覆盖率报告和测试列表映射到需求,输出覆盖缺口、补测优先级和不可达说明
建立 FPGA 固件/bitstream 版本、序列号和生产记录追踪方案
整理 Zynq DMA 从 PL 到 Linux 驱动和应用的完整联调路径,识别缓存、中断和设备树风险
整理 AI FPGA 加速器量化参数、数据布局、接口协议和验证向量
规划高速 IO 的 IBERT/收发器调试、眼图、BER、均衡参数、参考时钟和业务层误码定位
设计 FPGA CI 回归指标、流水线阶段、失败归因、趋势看板和发布门禁
为 ILA/SignalTap 调试建立可复用触发方案、采样深度建议和分阶段观测点
建立跨厂商 FPGA 工具链迁移清单,输出不可迁移项、替代方案和验证顺序
制定 FPGA 新板上电和最小系统 bring-up 流程,覆盖电源、时钟、配置、JTAG、复位和外设最小验证
将雷达/测控信号处理算法映射为 FPGA 定点流水线、数据帧、位宽、延迟、缓存和验证计划
核对 BRAM/URAM/DSP 推断结果、代码风格和工具报告,给出改写建议
建立 FPGA 上电复位时序图和检查表,降低启动偶发失败风险
设计 FPGA 冗余配置和 golden image 策略,提升现场可恢复性
设计 FPGA 系统校准参数持久化、校验、版本和回滚策略
构建面向真实 FPGA 工程能力的培训题库、实践任务和解析
把 FPGA 项目复盘材料整理成可进入知识库或转化为 Skill 的结构化资产
整理 MIPI CSI-2 D-PHY 从传感器配置到 FPGA 解包的联调步骤和证据
根据 utilization、timing 和层次结构规划 Pblock/Floorplan 调整方向
建立 HDMI/DisplayPort 显示链路时序、像素格式和测试图案检查流程
明确 FPGA 安全启动密钥、调试口和交付权限的边界,形成可审计流程
为 FPGA 发布包生成 bitstream、约束、源码版本、IP 版本、工具版本、测试结果、哈希和回退说明
检查 FPGA 配置模式、strap 电阻、启动介质和调试入口风险