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CI 回归失败分拣助手
SoC 软件与工程自动化4.8
从 CI 日志和 commit 范围中聚类失败原因,输出 owner、优先级和阻断项
CIDebugVivado
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更新于 06/11
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覆盖高速采集、PCIe DMA、10G Ethernet、Zynq、DDR、板卡调试与交付合规。
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从 CI 日志和 commit 范围中聚类失败原因,输出 owner、优先级和阻断项
梳理 25G/40G/100G Ethernet 从物理链路到包处理的数据通路和调试证据
规划 CameraLink/CoaXPress 采集链路、格式转换、缓存和验证方法
核对 PLL/MMCM/Clock Wizard 参数、复位 lock 处理和约束一致性
为多 FPGA 系统制定模块划分、互联带宽、同步和联调计划
从 timing report 中定位 FPGA 关键路径,区分约束问题、结构问题、布局问题和工具策略问题
审查 RISC-V 软核与 FPGA 外设集成、地址映射、启动路径和固件测试
分析 AXI-Stream 握手、FIFO 深度、时钟域和下游阻塞关系,输出吞吐瓶颈定位结论
为 FPGA/Zynq 项目制定 bitstream 加密、安全启动、密钥保护、版本回退和现场升级验证方案
建立可复现 EDA 环境清单和构建入口,降低工具版本和 license 差异导致的失败
评估 FPGA 低功耗时钟使能方案,避免错误门控和不可验证的功耗假设
建立 FPGA bitstream 远程升级和回滚方案,确保失败可恢复、版本可追溯