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规划 FPGA 以太网 MAC/PCS/PMA、UDP 封包、ARP、帧缓存、速率控制、丢包计数和主机抓包调试

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为神经网络 FPGA 加速器规划 tiling、DMA 调度、片上缓存和吞吐验证

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为 SoC FPGA 项目划分 PS、PL、DMA、DDR、驱动和应用软件职责，形成可实现的数据与控制架构

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规划高速 AD/DA 的采样时钟、数据对齐、FIFO 缓冲、触发时间戳、DDR/DMA 带宽和丢点检测

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按接口和风险等级规划 FPGA 产测向量、自动化测试流程和良率记录字段

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根据综合/实现报告识别 FPGA 资源瓶颈、低效结构、重复逻辑、过深缓存和 QoR 优化机会

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按模块估算 FPGA 资源、片上缓存、DDR 带宽、外设吞吐和时钟频率，提前发现器件瓶颈

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设计 FPGA 视频采集、解包、像素格式转换、帧缓存、ISP 预处理、显示或上位机输出链路

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建立多传感器 FPGA 时间戳对齐方案和误差分析流程

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规划 PCIe endpoint、BAR、MSI/MSI-X、中断、DMA 描述符、环形缓冲、主机驱动和吞吐测试

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规范 FPGA IP 发布包结构和版本说明，让团队能安全复用和审计

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制定 FPGA 硬件在环测试计划，明确接口映射、实时约束和验收口径

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评估异步 FIFO 参数、跨域安全、吞吐余量和边界条件测试是否满足项目要求

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生成 FPGA 相关 FMEA、降额关注项、失效检测策略、恢复动作和交付证据需求

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把 FPGA 项目进展、风险、阻塞、测试结果和下周计划整理成周报

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为航天/高可靠 FPGA 项目规划单粒子效应缓解、状态回读、配置刷新、ECC/TMR 和故障注入验证

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整理板卡 Bring-up 过程中的测试项、现象、证据、负责人和下一步动作

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规划多通道 FPGA 系统的时间、幅度和相位校准流程及证据记录

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审查 CAN/CAN FD/LIN/RS485 FPGA 接口、电气约束、错误处理和测试用例

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评估目标 FPGA 器件、核心板或开发板对接口、带宽、资源、温度、供货、工具链和量产成本的适配度

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审查 FMC 子卡与载板的电气、管脚、时钟和约束适配风险

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为 Nios/MicroBlaze 项目生成软硬件交接清单和启动调试路径

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审查高速接口相关时序例外，判断哪些是 IP 推荐、哪些是工程假设、哪些可能隐藏真实违例

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建立视频帧缓存和 VDMA 地址映射、缓存一致性、带宽和压力测试方案