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管脚与 Bank 电压规划助手
方案定义与器件选型4.8
鹏野嘉途v3.0.0
规划 FPGA 管脚、IO bank、电平标准和约束风险，提前发现硬件设计问题
FPGALVDSXDC
已验证100 次
更新于 06/11
Skill 市场
真实项目型 FPGA Skill 目录
覆盖高速采集、PCIe DMA、10G Ethernet、Zynq、DDR、板卡调试与交付合规。
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鹏野嘉途v3.0.0加入批量
PLL/MMCM 参数审查助手
约束时序与资源收敛4.6
鹏野嘉途v3.0.0核对 PLL/MMCM/Clock Wizard 参数、复位 lock 处理和约束一致性
PLLTimingXDC
已验证84 次
更新于 06/11
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FPGA Timing 收敛实战助手
约束时序与资源收敛4.7
鹏野嘉途v3.0.0从 timing report 中定位 FPGA 关键路径，区分约束问题、结构问题、布局问题和工具策略问题
TimingXDCVivado
已验证93 次
更新于 06/11
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XDC 管脚与时钟约束助手
约束时序与资源收敛4.7
鹏野嘉途v3.0.0生成和审查 FPGA 管脚、IOSTANDARD、create_clock、generated_clock、input/output delay、clock group 和约束缺口
XDCTimingVivado
已验证73 次
更新于 06/11
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XDC/SDC 跨工具约束助手
约束时序与资源收敛4.6
鹏野嘉途v3.0.0审查 XDC/SDC 约束跨工具迁移语义，标记需要人工确认的时序例外
XDCTiming国产迁移
已验证100 次
更新于 06/11