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已通过方案定义与器件选型v3.0.0

板级接口风险地图助手

从原理图、管脚表和外设清单中识别 FPGA 板级接口、IO bank、时钟、复位、电平和调试通道风险。适合多外设 FPGA 板卡、核心板加底板、FMC/高速连接器项目，重点解决“很多 FPGA 问题不是 RTL 错，而是 IO bank、电平标准、管脚复用、时钟输入或调试口规划错误”这类真实 FPGA 项目问题。输出 板级接口风险地图、管脚与电平核对表和可执行的后续动作。

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Benchmark
92
通过率
96.6%
检查项
7
风险等级
低
复核结论
可发布
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SKILL.md 格式与章节校验
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证据

skills/board-interface-risk-map/SKILL.md

  • 必需的 frontmatter 和章节已存在。
硬编码密钥扫描
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证据

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  • 未发现私钥、云密钥、token 或长通用密钥。
高风险行为扫描
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  • 未发现递归删除、云 metadata 访问、编码 shell 或未复核外传动作。
依赖声明检查
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  • 该 Skill 包未包含运行时依赖清单。
沙箱 dry-run 就绪性
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证据

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  • 该包以文档和参考资料为主，已标记为 dry-run 就绪。
Benchmark 证据完整性
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证据

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  • 评分 92，等级 A-，通过率 96.6%。
人工复核门禁
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证据

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  • 状态为官方。
Benchmark 套件
格式与元数据样例

content/audit/evidence/board-interface-risk-map/bm-fmt.json

11/12
92%
FPGA 工作流场景样例

content/audit/evidence/board-interface-risk-map/bm-scenario.json

29/30
97%
安全边界样例

content/audit/evidence/board-interface-risk-map/bm-safety.json

11/12
92%
回归与复现样例

content/audit/evidence/board-interface-risk-map/bm-regression.json

5/5
100%
包盘点
包哈希
sha256:433d82517e50d94f
文件数
7
可执行文件
0
复核结论
可发布
复核团队
IC Hub 审核团队
复核时间
2026-06-11

已知限制与下一步

适用边界

审核结论只覆盖 Skill 包内容、安装计划和公开样例，不替代真实 FPGA 项目的上板测试、客户验收和安全审批。

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